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MAX4145在伪随机码产生电路中的应用

时间:2007-1-20栏目:电子通信论文

  摘要:主要介绍了MAXIM公司的差分放大器MAX4145的技术参数、性能特点和典型应用,给出了MAX4145在扩频码序列产生电路中的电路原理和连接方法。
  
  关键词:伪随机码;差分放大器;CMRR;SFDR;MAX4145
  
  1 引言
  
  随着超大规模集成电路技术、(www.fwsir.com)微处理器技术的飞速发展和一些新型元器件的应用,扩频技术已经广泛地应用到通信的各个方面。图1所示是一种扩频通信系统的原理框图。
  
  一般情况下,扩频通信系统中的发射机和接收机都必须预先知道一个预置的扩频码,这种扩频码实际上是一个足够长且尽量接近于噪声的伪随机数字序列。系统通过伪随机码的捕获与相关可以获得二分之一码元宽度的同步精度。这样,伪随机码的质量以及跟踪和同步的精度对通信质量有着直接的影响。因此,设计性能优异的高共模抑制比、低噪声前置放大器对于扩频通信系统有着重要意义。MAXIM公司的差分放大器MAX4145芯片以其出众的性能在通信系统设计中应用很广,其指标完全可以满足扩频通信系统中伪码产生电路的要求。MAX4145系列芯片速率高、失真小、带宽宽而且共模抑制比高,是高速数据传输系统中差分电路的理想器件,因而可广泛应用于差分信号至单端信号的转换电路、双绞线与同轴线的转换设备、高速差分信号接收电路、高速放大设备、数据采集设备以及医疗器械等方面。
  
  2 MAX4145的工作原理和性能特点
  
  2.1 MAX4145的工作原理
  
  MAX4145采用差分模式工作。它具有信号摆幅小、偶次谐波分量少、对噪声的抗干扰能力强等特点,相对于单端输入方式,MAX4145可提供更优的谐波失真(THD)和无杂散动态范围(SFDR),因而具有较高的共模抑制比(CMRR)。
  
  MAX4145内部采用三运放组合技术,可完成差分输入、增益放大和信号输出三种功能。其内部结构如图2所示。其中,运放A1和A2完成差分输入和增益放大功能,运放A3主要进行信号的输出和阻抗匹配。
  
  MAX4145除了具有输入阻抗大的特点之外,其前级的共模增益失调及漂移产生的误差可相互抵消,并可抑制后级共模信号, 同时可将双端信号变为单端输出,以适应接地负载的需要。除了三个运放之外,MAX4145还包括输出短路自保护电路和输入保护电路,从而增加了芯片的抗毁性。通过外接电阻RG可对增益在+1V/V——+10V/V范围内进行设置。将RG接在管脚RG-和RG+之间时(见图2),其增益的计算方法为:
  
  G=AV=1+(1.4kΩ/RG)
  
  共模抑制比是衡量差动放大器对共模信号抑制能力的一个参数,该参数值越大,表明抑制能力越强。
  
  2.2 MAX4145的性能指标
  
  MAX4145的主要性能参数如下:
  
  ●增益可调范围为+1V/V——+10V/V;
  
  ●-3dB带宽为180MHz(VOUT≤0.1VRMS,AV=1V/V);
  
  ●压摆率SR=600V/μs(-2V≤VOUT≤+2V);
  
  ●共模抑制比CMRR=75dB(f=10MHz);
  
  ●无杂散动态范围SFDR=-92dBc(f=10kHz);
  
  ●噪声为3.8nV/√Hz(G=+10V/V);
  
  ●建立时间ts=20ns(-2V≤VOUT≤+2V,to 0.1%);
  
  ●掉电模式电流为800μA.
  
  3 MAX4145应用注意要点
  
  可以通过将SHDN置高来使MAX4145工作在掉电模式,此时输出为高阻态。
  
  差分模式通常要求IN-和IN+对称驱动,也就是说,两个输入信号在连接到IN-、IN+的驱动电路以后,其相位必须保持一致,并尽可能降低其共模增益误差。
  
  在普通应用中,REF接地时,SENCE可同OUT相连。而在一些信号传输距离较长的应用中,可将SENCE和OUT同时连接到负载,这样可以补偿距离损耗,降低电压误差。为了降低输出增益误差,增大频率响应,设计时应尽量降低SENCE端的电容和阻抗,同时输出端REF和SENCE的匹配问题也很关键,因为REF和SENCE端的失配会导致共模增益损失。
  
  在一般使用条件下,当端接阻抗为非容性负载时,MAX4145具有最佳的AC性能。而一般在负载电容不超过25pF时,输出电压不会发生振荡,但对频率响应则会产生一定的影响,因此,如果负载电容过大,输出就会产生振铃。为了驱动容性较大的负载,降低信号振铃,可以在放大器输出和负载之间加上隔离电阻,隔离电阻阻值可由信号频率和负载容性来确定,此时的带宽将由隔离电阻和负载电容组成的RC环路来决定。因此,增大负载容性会降低整个电路的信号带宽,而隔离电阻则会降低分配到负载的电压。
  
  4 在伪随机码产生电路中的应用
  
  4.1 伪随机码产生电路
  
  伪随机码序列一般可以利用移位寄存器网络产生,该网络由R级串联双态器件移位脉冲产生器和模二加法器组成。图3所示是一个简单的四级移位寄存器网络示意图,该网络可以产生码长为15的伪随机码。
  
  利用FPGA可实现移位寄存器网络以产生伪随机码

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