小容量的电容更靠近ＡＤＣ。所有信号，特别是时钟信号必须远离ＦＩＬＴ＋和ＶＱ引脚，接在ＦＩＬＴ＋和ＶＱ上的退耦电容必须放在与ＲＥＦＧＮＤ最近的位置。为了减小数字信号干扰，ＡＤＣ的数字输出应该只驱动ＣＭＯＳ输入端。图４是ＣＳ５３６１的典型应用电路连接图。
　　
　　由于ＡＤＣ只以有限频率采样模拟信号，因此，高于一定频率的信号可能会引起假频信号。另外，由于ＡＤＣ的输入阻抗有限，因此，在输入端还应加一定带宽的阻抗匹配电路，以改善ＡＤＣ的性能。
　　
　　由于ＡＤＣ参考电压的源阻抗以及外部滤波电容的影响，系统上电后，必须经过一段时间，参考电压才能稳定，因此，必须等待一段时间后才能得到准确的测量结果。另外在实际使用ＣＳ５３６１时，还有以下几点需要注意：
　　
　　（１）ＣＳ５３６１内部的数字滤波器为线性相移滤波器，因此应根据这一特点对不同频率信号的相位作出校正；
　　
　　（２）ＣＳ５３６１在开始工作时，由于要等待滤波器稳定，因此在滤波器稳定前可输出２０００个左右的无效数据，无效数据的具体个数与操作模式有关，此点应注意；
　　
　　（３）ＣＳ５３６１从ＭＣＬＫ稳定到第一个数据出现，有一定的延时，延时大小与操作模式有关；
　　
　　（４）ＣＳ５３６１转换器的四速模式和倍速模式时的信号带宽几乎完全一样，所不同的是四速模式时的输出采样率更高一些，滤波器的通频带也更宽一些，因此在满足采样率要求的前提下，应尽量采用低速操作模式，实际使用发现：ＣＳ５３６１在低速模式时的性能优于高速模式。
　　
　　（５）利用ＣＳ５３６１的高通滤波器进行直流偏移校正时，它只是去除了做直流标定前通道所产生的直流偏移，而对于在采样进行中产生的偏移，此功能不起作用。
　　
　　（６）ＣＳ５３６１的数据接口时序在左对齐格式和Ｉ２Ｓ格式时有很大的差别，这一点在使用时应引起足够的重视。
　　
　　（７）ＣＳ５３６１通常以２的补码格式交替连续输出两个通道的２４位采样数据，其信号满偏电压有效值为２Ｖ，这一点对格式变换十分有用。
　　
　　（８）ＣＳ５３６１的两个通道数据虽然是交替分时输出，但同一组数据的采样时刻却是同步的，它们分别代表同一时刻的两个通道模拟信号的值

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